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  • 數(shù)字IC設(shè)計(jì)工程師(ZY)

    18-25萬(wàn) | 天津市 | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    【崗位職責(zé)】1、完成模塊級(jí)結(jié)構(gòu)設(shè)計(jì),RTL實(shí)現(xiàn)及相關(guān)工作;2、協(xié)助芯片級(jí)架構(gòu)設(shè)計(jì)、RTL實(shí)現(xiàn)及相關(guān)工作; 3、協(xié)助芯片綜合、DFT、后端的設(shè)計(jì)和實(shí)現(xiàn);4、協(xié)助搭建仿真驗(yàn)證環(huán)境和FPGA驗(yàn)證環(huán)境;5、協(xié)助芯片測(cè)試方案設(shè)計(jì)和支持芯片測(cè)試工作;【任職資格】1、熟悉verilo...
  • 數(shù)字IC設(shè)計(jì)工程師

    24-40萬(wàn) | 深圳市 | 碩士 | 無(wú)經(jīng)驗(yàn)

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位職責(zé)1. 根據(jù)設(shè)計(jì)要求編寫設(shè)計(jì)文檔,定義設(shè)計(jì)規(guī)格書2. 編寫RTL 代碼 3. 對(duì)模塊集成,驗(yàn)證,調(diào)試,測(cè)試提供技術(shù)支持4. 對(duì)模塊或整體設(shè)計(jì)簡(jiǎn)單驗(yàn)證 5. FPGA實(shí)現(xiàn)驗(yàn)證并調(diào)試 6. 解決FPGA驗(yàn)證遇到的問題7. 參與設(shè)計(jì)流程的其他部分工作,包括綜合,形式驗(yàn)證...
  • 模擬IC設(shè)計(jì)工程師(模擬方...

    20-40萬(wàn) | 深圳市 | 碩士 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    你會(huì)參與到:1. 負(fù)責(zé)模擬子模塊電路規(guī)格定義以及電路設(shè)計(jì),包括OPAMP、COMP、LDO、BG、DC/DC、OSC、PLL等2. 依據(jù)芯片的規(guī)格要求完成電路設(shè)計(jì)以及文檔撰寫、仿真、驗(yàn)證等工作3. 指導(dǎo)版圖工程師完成版圖設(shè)計(jì),優(yōu)化4. 負(fù)責(zé)芯片從研發(fā)到量產(chǎn)的評(píng)估、測(cè)試、...
  • 模擬IC設(shè)計(jì)工程師(ADC...

    35-50萬(wàn) | 深圳市 | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位職責(zé)1. 模擬IP設(shè)計(jì)ADC方向,包括:SAR ADC、Pipeline-SAR ADC、Noise-Shaping ADC等設(shè)計(jì);2. 和系統(tǒng)工程師配合完成子模塊規(guī)格定制,依據(jù)芯片的規(guī)格要求完成電路設(shè)計(jì)、仿真、驗(yàn)證等工作;3. 負(fù)責(zé)電路關(guān)鍵部分Floor Plan...
  • 射頻芯片ic設(shè)計(jì)

    20-35萬(wàn) | 成都市 | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位職責(zé):能獨(dú)立參與砷化鎵(GaAs)射頻器件的研發(fā)設(shè)計(jì)。 1. 負(fù)責(zé)設(shè)計(jì)一種或多種射頻、微波芯片,包括但不限于LNA/開關(guān)/濾波器/低噪聲放大器/功率放大器/壓控振蕩器減器/移相器/混頻器等) 2. 負(fù)責(zé)完成相關(guān)產(chǎn)品設(shè)計(jì)、仿真、驗(yàn)證、調(diào)試、聯(lián)調(diào)和問題定位工作; 3. ...
  • 數(shù)字ic設(shè)計(jì)工程師

    40-70萬(wàn) | 杭州市 | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位職責(zé):1.負(fù)責(zé)芯片架構(gòu)設(shè)計(jì)及各個(gè)模塊設(shè)計(jì);2.負(fù)責(zé)芯片設(shè)計(jì)相關(guān)文檔的編寫;3.負(fù)責(zé)驗(yàn)證及芯片系統(tǒng)集成;4.參與數(shù)字電路的仿真和分析;5.協(xié)調(diào)模擬電路設(shè)計(jì)工程師,共同完成數(shù)模接口設(shè)計(jì);崗位要求:1.微電子、電子、通信等相關(guān)專業(yè)本科以上學(xué)歷;2.三年以上大規(guī)模數(shù)字IC設(shè)...
  • 射頻IC設(shè)計(jì)工程師

    20-40萬(wàn) | 深圳市 | 碩士 | 無(wú)經(jīng)驗(yàn)

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    1、負(fù)責(zé)基于GaAs、SiGe工藝的PA、LNA, Switch等射頻前端電路芯片及模塊設(shè)計(jì);2、負(fù)責(zé)RF器件和電路版圖設(shè)計(jì)及后仿和封裝仿真驗(yàn)證;3、負(fù)責(zé)射頻電路及模塊的實(shí)驗(yàn)室調(diào)試和封裝驗(yàn)證,撰寫測(cè)試文檔記錄;4、撰寫封裝文件、產(chǎn)品手冊(cè)、應(yīng)用文檔等。【任職資格】1、碩士...
  • IC設(shè)計(jì)工程師

    20-50萬(wàn) | 上海-閔行區(qū) | 碩士 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    Job De****ions:1. 負(fù)責(zé)D2D IP集成;2. 負(fù)責(zé)指定模塊規(guī)格書,編寫RTL 代碼,驗(yàn)證支持;3. 負(fù)責(zé)模塊綜合及時(shí)序分析;4. 負(fù)責(zé)芯片模塊功能調(diào)試和應(yīng)用支持Job Qualification:1. 微電子相關(guān)專業(yè);2. 精通verilog編程,具有...
  • IC設(shè)計(jì)工程師

    20-50萬(wàn) | 杭州市 | 碩士 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    Job De****ions:1. 負(fù)責(zé)D2D IP集成;2. 負(fù)責(zé)指定模塊規(guī)格書,編寫RTL 代碼,驗(yàn)證支持;3. 負(fù)責(zé)模塊綜合及時(shí)序分析;4. 負(fù)責(zé)芯片模塊功能調(diào)試和應(yīng)用支持Job Qualification:1. 微電子相關(guān)專業(yè);2. 精通verilog編程,具有...
  • IC設(shè)計(jì)工程師

    20-50萬(wàn) | 長(zhǎng)沙市 | 碩士 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    Job De****ions:1. 負(fù)責(zé)D2D IP集成;2. 負(fù)責(zé)指定模塊規(guī)格書,編寫RTL 代碼,驗(yàn)證支持;3. 負(fù)責(zé)模塊綜合及時(shí)序分析;4. 負(fù)責(zé)芯片模塊功能調(diào)試和應(yīng)用支持Job Qualification:1. 微電子相關(guān)專業(yè);2. 精通verilog編程,具有...
  • 高級(jí)數(shù)?;旌闲盘?hào)IC設(shè)計(jì)工...

    面議 | 成都市 | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位職責(zé):1. 負(fù)責(zé)音頻芯片數(shù)模混合模塊的研發(fā)設(shè)計(jì);2. 負(fù)責(zé)梳理、制定該模塊對(duì)數(shù)字控制邏輯、數(shù)字信號(hào)處理的功能需求;3. 負(fù)責(zé)該模塊的具體模擬電路的設(shè)計(jì)和仿真驗(yàn)證,并指導(dǎo)版圖設(shè)計(jì);4. 配合數(shù)字設(shè)計(jì)和驗(yàn)證工程師完成該模塊的數(shù)模混合驗(yàn)證;5. 配合測(cè)試工程師完成相關(guān)的測(cè)...
  • 模擬IC設(shè)計(jì)工程師(J12...

    22-40萬(wàn) | 蘇州市 | 本科 | 無(wú)經(jīng)驗(yàn)

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    職責(zé)描述:1、參與ADC、DAC類IP的設(shè)計(jì)、仿真與流片;2、負(fù)責(zé)相關(guān)IP的交付、測(cè)試與客戶支持;3、從布局、匹配、寄生等方面指導(dǎo)版圖設(shè)計(jì)和優(yōu)化。任職要求:1、微電子、集成電路工藝、物理等理工類相關(guān)專業(yè),本科及以上學(xué)歷,1年以上相關(guān)學(xué)習(xí)或項(xiàng)目經(jīng)驗(yàn),具備一定的版圖專業(yè)基礎(chǔ)...
  • 數(shù)字IC設(shè)計(jì)工程師

    22-50萬(wàn) | 上海-浦東新區(qū) | 本科 | 無(wú)經(jīng)驗(yàn)

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位職責(zé):1.參與基于工藝節(jié)點(diǎn)(14/12nm、7/5nm)的高速數(shù)?;旌想娐方涌谛酒脑O(shè)計(jì)、流片、驗(yàn)證;2.負(fù)責(zé)從netlist到GDS signoff的后端交付工作,完成頂層或模塊級(jí)設(shè)計(jì)的布局布線、時(shí)鐘樹綜合等;3.芯片的物理驗(yàn)證(DRC/LVS/IR)和時(shí)序驗(yàn)證(...
  • 數(shù)字IC設(shè)計(jì)高級(jí)工程師

    25-50萬(wàn) | 武漢市 | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    職責(zé)描述:1、負(fù)責(zé)PCIE相關(guān)功能模塊的設(shè)計(jì)與實(shí)現(xiàn),功能驗(yàn)證、邏輯綜合,時(shí)序分析;2、負(fù)責(zé)功能模塊相關(guān)設(shè)計(jì)文檔的編寫;3、協(xié)助驗(yàn)證工程師完成系統(tǒng)驗(yàn)證,提升驗(yàn)證覆蓋率;4、協(xié)助后端設(shè)計(jì)工程師,完成時(shí)序、版圖和Floorplan的優(yōu)化;5、完成模塊設(shè)計(jì)交付工作,包括SDC/...
  • 模擬IC設(shè)計(jì)工程師

    30-60萬(wàn) | 武漢市 | 本科 | 無(wú)經(jīng)驗(yàn)

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    職責(zé)描述:1、參與基于工藝節(jié)點(diǎn)(14/12nm、7/5nm)的GPU和存儲(chǔ)器等大型芯片中,各種全定制高速高性能混合電路和計(jì)算內(nèi)核模塊的設(shè)計(jì)仿真流片全流程;2、參與負(fù)責(zé)數(shù)?;旌想娐稩P的前端設(shè)計(jì)、前后仿真、測(cè)試和系統(tǒng)驗(yàn)證的工作,指導(dǎo)協(xié)助完成版圖設(shè)計(jì)并編寫相關(guān)技術(shù)設(shè)計(jì)和測(cè)試...
  • 模擬IC設(shè)計(jì)工程師(PCI...

    25-50萬(wàn) | 武漢市 | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    職責(zé)描述:1、參與基于工藝節(jié)點(diǎn)(14/12nm、7/5nm)的GPU和存儲(chǔ)器等大型芯片中,各種全定制高速高性能混合電路和計(jì)算內(nèi)核模塊的設(shè)計(jì)仿真流片全流程;2、參與負(fù)責(zé)數(shù)?;旌想娐稩P的前端設(shè)計(jì)、前后仿真、測(cè)試和系統(tǒng)驗(yàn)證的工作,指導(dǎo)協(xié)助完成版圖設(shè)計(jì)并編寫相關(guān)技術(shù)設(shè)計(jì)和測(cè)試...
  • 數(shù)字IC設(shè)計(jì)高級(jí)工程師(P...

    25-50萬(wàn) | 武漢市 | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    職責(zé)描述:1、負(fù)責(zé)PCIE相關(guān)功能模塊的設(shè)計(jì)與實(shí)現(xiàn),功能驗(yàn)證、邏輯綜合,時(shí)序分析;2、負(fù)責(zé)功能模塊相關(guān)設(shè)計(jì)文檔的編寫;3、協(xié)助驗(yàn)證工程師完成系統(tǒng)驗(yàn)證,提升驗(yàn)證覆蓋率;4、協(xié)助后端設(shè)計(jì)工程師,完成時(shí)序、版圖和Floorplan的優(yōu)化;5、完成模塊設(shè)計(jì)交付工作,包括SDC/...
  • 數(shù)字IC設(shè)計(jì)工程師

    35-45萬(wàn) | 上海-徐匯區(qū) | 碩士 | 無(wú)經(jīng)驗(yàn)

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位職責(zé):1.和團(tuán)隊(duì)一起定義芯片spec,撰寫模塊設(shè)計(jì)文檔。2.獨(dú)立完成數(shù)字模塊RIL設(shè)計(jì)以及相關(guān)驗(yàn)證工作。3.參與芯片設(shè)計(jì)驗(yàn)證流程,包括FPGA驗(yàn)證及數(shù)字后端支持。4.配合TE和PE工程師完成芯片的相關(guān)測(cè)試。任職要求:1、微電子,電子工程,計(jì)算機(jī)類相關(guān)專業(yè),碩士及以上...
  • IC設(shè)計(jì)工程師-PCIe

    40-70萬(wàn) | 上海-浦東新區(qū) | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位要求:1.負(fù)責(zé)PCIe子系統(tǒng)的整體設(shè)計(jì)方案;2.完成PCIe控制器及相關(guān)系統(tǒng)模塊集成,通過(guò)前端設(shè)計(jì)流程(Lint/CDC/RDC)的各項(xiàng)檢查。3.完成PHY模塊的集成,通過(guò)前端設(shè)計(jì)流程(Lint/CDC/RDC)的各項(xiàng)檢查。4.與DFT配合,在RTL中嵌入DFT要求...
  • 數(shù)字IC設(shè)計(jì)工程師

    18-30萬(wàn) | 北京-海淀區(qū) | 本科 | 1年以下

    發(fā)布于:2025-02-26 | 投遞后:10天內(nèi)反饋

    崗位職責(zé):1、參與數(shù)字集成電路(IC)的設(shè)計(jì)和開發(fā),包括但不限于模塊級(jí)RTL代碼編寫、仿真驗(yàn)證。2、負(fù)責(zé)芯片設(shè)計(jì)中的前端流程,包括邏輯綜合、形式驗(yàn)證、靜態(tài)時(shí)序分析等。3、協(xié)助完成FPGA原型驗(yàn)證工作,確保設(shè)計(jì)的功能正確性和性能達(dá)標(biāo)。4、與跨職能團(tuán)隊(duì)合作,如模擬設(shè)計(jì)、物理...